A40i & T3 核心板原理圖及引腳定義

原創 2020-12-08 15:13:00 A40i T3

一、A40i/T3簡介

A40i是全志在智能工控領域的一款高性能、超高效處理器。A40i采用ARM Cortex-A7內核,運行頻率高達1.2GHz,配備Mali400 MP2圖形處理器及多種顯示接口,并具有豐富的行業應用接口,主要應用于各種具有視頻輸出的工控行業。A40i配套使用的PMIC支持外部電源、USB、鋰電池三種供電方式,并集成了供電路徑選擇和鋰電池充放電管理功能,極大簡化了終端產品的設計難度。

    T3是全志的一款四核車載導航處理器,功能及引腳與A40i 完全兼容。T3為汽車級芯片,能適應更加嚴酷的工作環境。

二、FETA40i /T3-C核心板介紹 

1、FETA40i-C核心板外觀圖

 

 

正面視圖

反面視圖

 

2、FETT3-C核心板外觀圖

 

 

正面視圖

反面視圖

 


三、FETA40i/T3-C核心板引腳定義

 

1、FETA40i/T3-C核心板引腳原理圖

 

2、FETA40i/T3-C核心板引腳功能說明

注1:

    Num ——核心板連接器引腳序號;

    Ball——CPU引腳球號

    GPIO ——CPU引腳通用I/O口序號

    Vol  —— 引腳信號電平

注2:

信號名稱 ——核心板連接器網絡名稱,信號右上角角標含義如下圖:

角標序號

角標含義

[1]

引腳可配置為中斷使用

[2]

引腳默認電平為1.8V

[3]

引腳為CPU啟動相關引腳,不推薦作為IO使用

[4]

專用引腳,不能作為IO使用

    引腳描述 ——核心板引腳信號名稱描述  

    默認功能——核心板所有引腳功能均按下表的“默認功能”作了規定,請勿修改,否則可能和出廠驅動沖突。如有疑問,請及時聯系我們的銷售或技術支持。

注3:“默認功能”一欄中標明“底板勿用”的引腳是核心板使用的引腳,底板設計時不可使用


表1  LEFT_UP(P1)連接器接口(奇)引腳定義

NUM

BALL

信號名稱

GPIO

VOL

引腳描述

默認功能

LU_79

ACIN

3.9-6.3V

電源輸入

ACIN

LU_77

ACIN

3.9-6.3V

電源輸入

ACIN

LU_75

ACIN

3.9-6.3V

電源輸入

ACIN

LU_73

ACIN

3.9-6.3V

電源輸入

ACIN

LU_71

VBAT

3.8-4.2V

鋰電池輸入

VBAT

LU_69

VBAT

3.8-4.2V

鋰電池輸入

VBAT

LU_67

VBAT

3.8-4.2V

鋰電池輸入

VBAT

LU_65

VBAT

3.8-4.2V

鋰電池輸入

VBAT

LU_63

GND

GND

LU_61

GND

GND

LU_59

AB17

SPI0_CS0[2] [3]

PC23

1.8V

SPI0片選(低有效)

SPI0_CS0

LU_57

AC10

SPI0_MISO[2] [3]

PC1

1.8V

SPI0數據,主入從出

SPI0_MISO

LU_55

AB11

SPI0_MOSI[2] [3]

PC0

1.8V

SPI0數據,主出從入

SPI0_MOSI

LU_53

AD10

SPI0_CLK[2] [3]

PC2

1.8V

SPI0時鐘

SPI0_CLK

LU_51

GND

GND

LU_49

V23

SDC3_DET[1]

PI10

3.3V

SDC3卡檢測

SDC3_DET

LU_47

W24

SDC3_D1

PI7

3.3V

SDC3數據位1

SDC3_D1

LU_45

W23

SDC3_D0

PI6

3.3V

SDC3數據位0

SDC3_D0

LU_43

GND

GND

LU_41

W22

SDC3_CLK

PI5

3.3V

SDC3時鐘

SDC3_CLK

LU_39

Y23

SDC3_CMD

PI4

3.3V

SDC3命令

SDC3_CMD

LU_37

V22

SDC3_D3

PI9

3.3V

SDC3數據位3

SDC3_D3

LU_35

W20

SDC3_D2

PI8

3.3V

SDC3數據位2

SDC3_D2

LU_33

GND

GND

LU_31

AB23

UART4_TX

PG10

3.3V

UART4發送數據

UART4_TX

LU_29

AB24

UART4_RX

PG11

3.3V

UART4接收數據

UART4_RX

LU_27

AC23

UART3_RTS

PG8

3.3V

UART3請求發送

UART3_RTS

LU_25

AC24

UART3_CTS

PG9

3.3V

UART3清除發送

UART3_CTS

LU_23

AD22

UART3_TX

PG6

3.3V

UART3發送數據

UART3_TX

LU_21

AD23

UART3_RX

PG7

3.3V

UART3接收數據

UART3_RX

LU_19

GND

GND

LU_17

E23

SDC1_EN[1]

PH1

3.3V

SDC1使能

SDC1_EN

LU_15

Y20

SDC1_CLK

PG1

3.3V

SDC1時鐘

SDC1_CLK

LU_13

AA20

SDC1_CMD

PG0

3.3V

SDC1命令

SDC1_CMD

LU_11

AB21

SDC1_D0

PG2

3.3V

SDC1數據位0

SDC1_D0

LU_9

AC21

SDC1_D1

PG3

3.3V

SDC1數據位1

SDC1_D1

LU_7

AB22

SDC1_D2

PG4

3.3V

SDC1數據位2

SDC1_D2

LU_5

AC22

SDC1_D3

PG5

3.3V

SDC1數據位3

SDC1_D3

LU_3

U22

PI15[1]

PI15

3.3V

通用I/O口

PI15

LU_1

GND

GND

 由于篇幅有限,請下載完整版閱讀: A40i & T3 核心板原理圖及引腳定義

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